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USB2.0 电路设计核心关键点(源自 USB2.0 官方规范文档)

发布时间:2026/11/3 21:27:44 来源:云帆数科 栏目:资讯中心
USB2.0 电路设计核心关键点(源自 USB2.0 官方规范文档)
一、拓扑结构硬性约束层级限制USB物理是分层星型拓扑最大7层Tier1~Tier7主机为Tier1一条通信路径中最多允许5个非根HUB复合设备本身占用2层不能放在第7层第7层只允许普通功能设备。一条 USB 链路从电脑出发最多串 5 个 HUB总层级不超过 7 层设备数量7bit设备地址地址0为复位默认地址单主机控制器最多127个设备。HUB重点事务转换器TTTransaction Translator高速HUB必须带TT实现高速主机 ↔ 全速/低速设备协议转换没有TT的USB1.1 HUB挂载在USB2.0主机下下游全部是全速/低速带宽会占用总线资源HUB分为Hub Repeater中继器、Hub Controller、TT三部分。拓扑只能树型禁止环路只有1个Host主机不能多主机。二、电气信号设计D / D‑差分对重中之重三种速率高速High‑Speed480Mb/s全速Full‑Speed12Mb/s低速Low‑Speed1.5Mb/s仅用于键鼠等简单交互设备不支持BULK批量传输。高速设备上电先以全速模式枚举总线复位握手后切换到480M高速模式高速设备必须兼容全速响应标准设备请求Set‑Address、Get‑Descriptor等。速度识别上拉/下拉电阻设备端全速/高速设备D接1.5kΩ上拉3.3V低速设备D‑接1.5kΩ上拉3.3V。Host/HUB下游端口D、D‑各15kΩ下拉到GND上拉电阻用来通知主机设备插入、识别速率很多USB芯片内部集成该电阻固件可控开关硬件外部电阻按需取舍。差分阻抗要求差分对D/D‑差分阻抗90Ω±15%PCB走线、线缆全程保持阻抗连续减少反射、眼图恶化差分对内两根走线尽量等长控制skew时序偏移高速模式对信号抖动、上升/下降沿单调有严格规范不能有过冲震荡。编码NRZI编码位填充Bit‑Stuffing每包开头必须有SYNC同步域用于接收端PLL锁时钟EOP包结束标志协议内置CRC5令牌包、CRC16数据包做错误检测。线缆规格4根导线VBUS、D、D‑、GND高速/全速线缆必须双绞屏蔽单段线缆最大5m。三、电源VBUS设计VBUS标称5V分总线供电Bus‑Powered、自供电Self‑Powered两类设备。总线供电设备全部由VBUS取电。总线供电HUB有严格功耗限制低功耗设备最大100mA高功耗设备最大500mA。自供电设备自带电源从USB总线汲取电流不允许超过100mA。描述符bMaxPower配置描述符中上报设备消耗电流单位2mA硬件实际功耗严禁超过该上报值Get‑Status指令可以读取设备供电模式硬件功耗要和描述符匹配。挂起Suspend电流约束挂起状态设备总电流必须小于规定值主机/Hub会检测挂起、恢复Resume信号支持远程唤醒Remote‑Wakeup功能需要设备描述符开启Feature。HUB端口电源支持端口独立电源控制过流检测、过流上报总线供电HUB不能无限制向下游输出电流。需要做压降预算线缆、连接器IR压降不能超出规范范围。四、端点Endpoint与传输类型硬件相关约束所有USB设备必须实现Endpoint0控制端点双向默认控制管道Default Control Pipe设备复位后地址0就可用用于枚举、标准请求其他端点必须等设备配置完成后才能使用。 四种传输类型硬件限制控制传输Control端点0所有设备必备。低速最大包8字节全速8/16/32/64字节高速固定64字节微帧预留20%带宽给控制传输。批量Bulk仅全速、高速支持低速设备不能有BULK端点高速Bulk最大包512字节全速最大64字节占用剩余空闲带宽无带宽保证。中断Interrupt低速最大包8字节全速最大64字节高速最大1024字节有最大服务周期保证适合键鼠。高速高带宽中断端点可1微帧最多3次事务。同步Isochronous只有全速/高速用于音视频不做重传错包直接丢弃需要预先预留带宽不能重试纠错高速高带宽同步端点单微帧最多3072字节数据依赖SOF帧同步时钟。高速高带宽端点wMaxPacketSize高11‑12bit标识每个微帧事务数量1‑3次硬件、固件描述符必须配置正确。五、机械与连接器要点Upstream设备侧上行口、DownstreamHUB下游口A/B连接器物理防呆不能互换避免环路禁止设计非法线缆。连接器外壳屏蔽地处理屏蔽外壳不能直接短接信号GND注意隔离防止地环路干扰。线缆高速/全速必须屏蔽双绞线低速线缆可以非屏蔽导线AWG线规要匹配功率保证压降满足要求。六、硬件必须配合协议的关键点电路设计要留给固件实现条件设备枚举Bus Enumeration流程硬件条件插入检测D / D‑上拉→复位 →地址分配Set‑Address→读取各类描述符Device、Configuration、Interface、Endpoint→Set‑Configuration配置设备端点才工作。硬件必须支持总线复位信号。设备状态Default、Address、Configured、Suspend硬件电路要支持总线复位、挂起/恢复信号识别。HUB硬件必须支持端口连接/断开检测、端口复位、端口电源开关、过流检测上报带TT的HUBTT缓冲区硬件资源要满足分割事务Split‑Transaction要求用于高速主机和全速/低速设备通信Split事务对时序要求严格。七、常见踩坑清单电路设计特别注意❌ 高速设备省略上拉电阻无法识别电阻阻值偏离1.5kΩ规格造成识别不稳定。❌ D D‑差分走线阻抗不控制、大量过孔、走线过长高速480M枚举失败只能跑全速12M。❌ 低速设备设计BULK批量端点协议不支持会通信异常。❌ 总线供电设备实际电流大于描述符bMaxPower上报电流导致主机复位设备。❌ 高速HUB不带TT下游接全速设备带宽异常通信卡顿。❌ 拓扑层级超过7层复合设备放在第7层无法正常工作。❌ VBUS走线太细线缆压降超标设备不稳定。❌ 忽略Suspend挂起电流挂起电流超标主机直接复位设备。❌ 高速设备只做硬件480M不兼容全速响应标准请求枚举直接失败。❌ 同步传输期望出错重传硬件没有意识到同步传输不支持重传丢包后软件反复重试无效。

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